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選擇電源接地系統會直接影響EMC PCB設計

如果威廉莎士比亞作為電氣工程師而不是詩人和劇作家怎么樣?如果電子產品存在于十六世紀中后期,那么Bard可能已經研究了電磁干擾(EMI)對電路的影響以及對電磁兼容性(EMC)的需求。畢竟,他在“暴風雨”中寫下了他對噪音的迷戀:

選擇電源接地系統會直接影響EMC PCB設計 PCB打樣

“不要冒犯;島上充滿了噪音,聲音和甜蜜的氣息,令人高興和不受傷害。
有時候,一千個嗡嗡作響的樂器會哼著我的耳朵;有時聲音......“

與許多試圖解決信號EMI的情況一樣,游戲中的角色Caliban無法描述噪聲源。

當a出現EMI時組件或系統在附加電壓耦合產生電磁干擾后會降級。降級會導致組件或系統成為EMI源,將干擾傳播到其他易受影響的系統,子系統,電路或源組件。您可能希望“聲音”而且,甜蜜的氣氛,令人高興和傷害不是?!跋喾?,EMI讓我想到了”千萬雙重樂器“和出現在普羅斯佩羅的召喚和呼喚的精神。正如塞巴斯蒂安和安東尼奧在”暴風雨“中策劃和策劃,“幾個吵鬧的惡棍會破壞電路性能。

反對電磁兼容性的惡棍

在分段接地層上布線通道線路也有效地提高了EMI信號的完整性。當線穿過線段之間的開口時,每個間隙與其跡線和線纜連接器連接,并且愉快地用作RF天線。電源將電流和RF能量饋送到時鐘電路,而這些電路可以同步切換并產生大的噪聲尖峰。開關穩壓器內產生的反射高頻電流可以通過直通電源線退出電路或通過其他路徑耦合輸出。

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了解您的組件相互影響的程度至關重要。

降低EMI的實用方法

減少EMI不一定是一個顫抖的旅程,你當然不必成為劇作家。暴風雨有五種行為,有三種主要做法可以減少你的EMI。你選擇哪個看起來不那么復雜:

1。建立電磁兼容性

使用EMC建立電路消除或大幅降低EMI的能力,并減少對其他電路的噪聲影響。大部分工作始于減少信號電流回路區域并提供將信號電流返回其源的低阻抗路徑。 EMC還描述了該電路如何提高其抗EMI能力,并定義了電路板,任何外殼,任何連接電纜以及防止EMI的電源的能力。

2。從良好接地平面開始

選擇電源接地系統會直接影響EMC PCB設計。由于分區接地層為電流回路提供了機會,因此應使用具有堅固接地層的多層PCB。此外,您還可以在電路邊緣放置鋁或鉭去耦電容,以減少電源和接地參考平面注入的噪聲。

高頻電路需要特別注意接地??焖賶簲[率會增加數字信號的諧波并產生EMI。使用更大的實心接地層可以產生阻抗非常低并且EMI抑制最大化的區域。您可能需要考慮使用多點接地來降低接地回路電流和平面的接地阻抗。

連接在電源和接地層之間的去耦電容可以減少電磁干擾。 0.01μF或0.1μF陶瓷電容為IC提供額外電流,通過低電感路徑和IC電源引腳切換狀態。此外,去耦電容產生從IC接地參考引腳到接地參考平面的低電感路徑。

3。隔離信號

使用多層印刷電路板,您可以將信號層放置在直流電源和接地參考平面之間。在高速信號層和DC電壓層之間以及高速信號與頂層和底層之間創建空間導致跡線僅作為跡線存在。從那里,您應該考慮使用多個配電總線將敏感電路彼此隔離。

通過智能選擇和放置開關穩壓器,微控制器,振蕩器和數字IC,可實現良好的EMC。首先,將整個電路視為功能子單元或電路分區。專注于電磁兼容性的分區根據其作為EMI源,受害者,路徑和無源電路的潛力來分離組件。在將組件劃分為功能塊后,將屏蔽EMI濾波器和去耦電容器合并,以實現額外的EMI抑制。

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確保降低EMI的設計將使您更容易實現電磁兼容性。

通過信號跟蹤觀察最佳實踐

忽略跟蹤布局的最佳實踐創建了耦合路徑,可以輕松地將噪聲從源移動到受害者。您可以通過以下方式實現電磁兼容性:

在地層和源電壓平面之間的層中布線時鐘走線。

使用更寬的時鐘信號的走線可以降低高頻阻尼和走線之間電容耦合的可能性。

通過消除直角或十字來避免走線電容。

消除導致串擾的長并行時鐘走線。

確保走線之間存在一致的間距,并且間距至少等于一個走線寬度。

不幸的是,所有系統和電路都會產生EMI并且具有不同的EMI敏感度。隨著消費者購買更多智能設備和設備,分析EMI風險的需求變得更大。如果不加以控制,EMI會導致嚴重的失敗。

在The Tempest中,Caliban想知道魔法是否會引起他所經歷的噪音。雖然有些人可能認為控制EMI需要魔法粉塵,但遵循良好實踐可以解決干擾問題。使用正確的PCB設計軟件也可能看起來很神奇 - 尤其是當它幫助您規劃跟蹤路由,有效分配組件以及檢查信號完整性時。

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